Stage : Développement IPs de décodage IRIG (F/H)

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Nous recherchons un stagiaire en développement IPs de décodage IRIG (F/H) pour une durée de 6 mois à partir du 1er trimestre 2027 au sein de la division Land & Sea sur le site d’Angoulême.

Missions:
Analyser la norme IRIG relative à l'encodage et à la transmission de l'horodatage.

Développer des IPs de décodage du protocole IRIG-B, prenant en charge l'ensemble des expressions codées :
Détection des symboles (0, 1, espace) dans les signaux de datation.

Décodage des trames IRIG-B.

Réaliser la validation fonctionnelle sur un SoC de type MPSoC Zynq UltraScale+ d'AMD, intégré sur une carte développée en interne.

Assurer l'intégration des IPs au sein du sous-système Chrony de Linux (développement de la partie driver Linux).

Profil recherché:
Étudiant(e) en dernière année d'école d'ingénieurs ou de master (Bac+5), dans un domaine en lien avec l'électronique numérique, les systèmes embarqués ou l'informatique industrielle.

Maîtrise ou connaissances des outils Xilinx Vivado et Vitis.

Connaissances des langages C/C++, en environnement Linux, notamment pour le développement de drivers.

Connaissances du langage VHDL et de TCL.

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我们正在招聘一名IRIG解码IP开发实习生（F/H），实习期为6个月，从2027年第一季度开始，隶属于Land & Sea部门，工作地点位于昂古莱姆。

任务：
分析IRIG标准中有关时间戳编码和传输的内容。

开发IRIG-B协议解码IP，支持所有编码表达形式：
在授时信号中检测符号（0、1、空格）。

解码IRIG-B帧。

在AMD的MPSoC Zynq UltraScale+类型的SoC上进行功能验证，该SoC集成在内部开发的板卡上。

确保将IP集成到Linux的Chrony子系统中（开发Linux驱动部分）。

期望人选：
工程学校或硕士最后一年在读学生（Bac+5），专业方向与数字电子、嵌入式系统或工业信息学相关。

掌握或了解Xilinx Vivado和Vitis工具。

了解C/C++语言，熟悉Linux环境，尤其是用于驱动开发。

了解VHDL语言和TCL。

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